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IDT71V67703, IDT71V67903, 256K x 36, 512K x 18, 3.3V Synchronous SRAMS with
3.3V I/O, Flow-Through Outputs, Single Cycle Deselect Commercial and Industrial Temperature Ranges
Non-Burst Read Cycle Timing Waveform
CLK
AD SP
AD SC
ADDRESS
Av
Aw
Ax
Ay
Az
G W , BW E , BW x
CE , CS 1
CS 0
OE
NOTES:
DATA OUT
(Av)
(Aw)
(Ax)
(Ay)
5309 drw 10
,
1. ZZ input is LOW, ADV is HIGH and LBO is Don't Care for this cycle.
2. (Ax) represents the data for address Ax, etc.
3. For read cycles, ADSP and ADSC function identically and are therefore interchangable.
Non-Burst Write Cycle Timing Waveform
CLK
AD SP
ADSC
ADDRESS
Av
Aw
Ax
Ay
Az
GW
CE , CS 1
CS 0
DATA IN
(Av)
(Aw)
(Ax)
(Ay)
(Az)
,
5309 drw 11
NOTES:
1. ZZ input is LOW, ADV and OE are HIGH, and LBO is Don't Care for this cycle.
2. (Ax) represents the data for address Ax, etc.
3. Although only GW writes are shown, the functionality of BWE and BW x together is the same as GW .
4. For write cycles, ADSP and ADSC have different limitations.
18
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